FPGAの論理設計エンジニア(@株式会社アイシーオー)
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サマリー- 株式会社アイシーオー
- 2021-08-05
- 正社員
- 神奈川県横浜市
- ハローワーク横浜
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■組込み機器の信号処理論理設計業務ＦＰＧＡ論理設計～ＲＴＬのコーディング（Ｖｅｒｏｉｌｏｇ）～検証まで一連の業務を担当していただく予定です。
求人内容
- 月給 20.0万円〜45.0万円
-
勤務時間：
就業時間
9時00分〜18時00分 -
休日：
123日
休日
土曜日，日曜日，祝日
週休二日制
毎週 / - 年間休日：0
- 雇用期間：雇用期間の定めなし
応募資格
-
年齢：制限あり
年齢制限範囲
〜64歳
年 - 資格：不問
- 必要経験：不問
- 学歴：不問
その他詳細
- 採用予定人数：3人
- 掲載終了予定：2021-10-31
- 特記事項：
求人企業情報
- 〒220-0003
- TEL：00
- FAX：00
- 事業概要：ソフトウェアの設計・開発および評価・検証（派１４−３０２０７２）
- 従業員数： 事業所 0人 / 事業所(女性)：0人 / 全社：0人
掲載元
- 管轄：ハローワーク横浜
- 求人票番号：14010-35665511
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