LSIの開発を行います。主に、論理検証業務を担当して頂きます。
テストパターンの作成や、シュミレーターを用いた回路シュミレーションを担当して頂きます。
【使用言語】Verilog−HDL,VHDL(いずれかのご経験)
【ツール】主にSynopsys,Cadense製ツール
(VCS,NC−Verilog等)
是非、応募お待ちしております。
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